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2025年综合类-电气工程专业基础-数字电子技术历年真题摘选带答案(5卷-选择题)

2025年综合类-电气工程专业基础-数字电子技术历年真题摘选带答案(篇1)

【题干1】全加器（FullAdder）的输入包括两个二进制加数和1位来自低位的进位输入，其输出包含和位与进位位。若输入为A=1，B=1，Cin=1，则输出S和Cout分别为多少？

【选项】A.S=0，Cout=1；B.S=1，Cout=0；C.S=1，Cout=1；D.S=0，Cout=0

【参考答案】C

【详细解析】全加器的逻辑表达式为S=A⊕B⊕Cin，Cout=AB+Cin(A⊕B)。当A=1，B=1，Cin=1时，S=1⊕1⊕1=1，Cout=1×1+1×(1⊕1)=1+0=1，故正确答案为C。选项A和D违反全加器基本逻辑关系，B仅考虑部分情况。

【题干2】8421BCD码中，数字9的编码为（）

【选项】A.1001；B.1000；C.1001；D.1111

【参考答案】A

【详细解析】8421BCD码采用四位二进制数表示十进制数，其中权值分别为8、4、2、1。数字9对应四位二进制数1001（8+1=9），选项B为8的编码，D为15的非法编码，C与A重复。

【题干3】某编码器有16个输入线，输出为4位二进制码，该编码器属于（）

【选项】A.二进制编码器；B.优先编码器；C.8421BCD编码器；D.格雷码编码器

【参考答案】A

【详细解析】16个输入对应2^4=16种状态，符合二进制编码器定义（n位输出可表示2^n种输入）。优先编码器需有优先级排序，8421码仅针对十进制数，格雷码需满足相邻编码仅1位变化，均不符合题意。

【题干4】下列电路中，属于组合逻辑电路的是（）

【选项】A.D触发器；B.寄存器；C.全加器；D.移位寄存器

【参考答案】C

【详细解析】组合逻辑电路输出仅由当前输入决定，无存储元件。全加器通过当前输入A、B、Cin计算输出S和Cout，属于典型组合电路。D触发器、寄存器和移位寄存器均含存储元件，属于时序电路。

【题干5】某多路选择器（MUX）有4个数据输入D0-D3，2-4译码器输出作为地址选择信号，当地址为A1=1，A0=0时，被选中的输入为（）

【选项】A.D0；B.D1；C.D2；D.D3

【参考答案】C

【详细解析】2-4译码器输出中，当A1=1，A0=0时，对应第三个数据输入（从0开始计数）。若译码器输出Y2有效，则选中D2输入，选项C正确。注意译码器输出顺序需与数据输入顺序严格对应。

【题干6】同步计数器由触发器构成，其工作特点为（）

【选项】A.每个触发器时钟独立；B.所有触发器同步受同一时钟控制；C.仅部分触发器受时钟控制；D.时钟与数据输入异步

【参考答案】B

【详细解析】同步计数器核心特征是所有触发器共用同一时钟信号，在时钟边沿同时更新状态。选项A描述的是异步（行波）计数器，C和D不符合同步计数器定义。

【题干7】某RAM芯片的容量为64K×8位，其存储单元数量为（）

【选项】A.64K；B.512K；C.128K；D.256K

【参考答案】A

【详细解析】RAM容量表示存储单元数量×每个单元位数。64K×8位即64K（65536）个存储单元，每个单元8位。选项B为总位数（64K×8=512K位），C和D为错误计算结果。

【题干8】在二进制数运算中，1111（B）+1001（B）=（）

【选项】A.10110（B）；B.11010（B）；C.11110（B）；D.10101（B）

【参考答案】A

【详细解析】二进制加法运算：

1111

+1001

------

10110

（末位产生进位链，共4位输入+1位进位输出）

选项B少计进位，C多计进位，D为减法结果。

【题干9】格雷码（GrayCode）的特点是相邻两个编码仅（）

【选项】A.1位不同；B.2位不同；C.3位不同；D.全部位不同

【参考答案】A

【详细解析】格雷码核心特性是相邻两个编码仅1位不同，避免二进制编码在计数时出现多位同时翻转的冒险现象。选项B对应循环码，C和D不符合实际应用需求。

【题干10】某存储器的地址线为12位，则其存储单元数量为（）

【选项】A.4096；B.8192；C.16384；D.32768

【参考答案】C

【详细解析】地址线位数n对应存储单元数量2^n。12位地址可寻址2^12=4096个单元，但选项C为4096×4（假设每个单元4位），需结合题目是否