电容阵列开关时序优化在AD转换器中的应用.pdfVIP

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2017-09-13 发布于重庆
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电容阵列开关时序优化在AD转换器中的应用.pdf

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( ) 第 4 卷第 6 期江南大学学报自然科学版 Vol . 4 　No . 6 　　　　 2005 年 12 月 Journal of Southern Yangtze University( Natural Science Edition) 　　　 Dec . 　2005 　文章编号 :167 1 - 7 147 (2005) 06 - 0555 - 05 电容阵列开关时序优化在 A /D 转换器中的应用朱丰 , 　吴晓波 , 　郜小茹 , 　严晓浪 (浙江大学超大规模集成电路设计研究所 ,浙江杭州 3 10027) 摘　要 : 欲提高逐次逼近式 A/ D 转换器的精度 ,常受到内部 DA C (Digit altoA nalo g Co nvert er ) 结构参数误差等因素的制约 , 同时 A/ D 转换器的低功耗问题亦受到关注. 为减小电荷分布式 DA C ( ) 中电容离散引入的积累梯度误差 , 改善输出积分线性度 INL ,int egral nonlinearit y , 引入 INL boun ded 算法对实际工艺条件下的 DA C 电容阵列的导通时序进行了优化. 通过引入预增益级和 L at ch 级 ,改进了内部比较器的结构 ,降低了静态功耗 ,提高了转换精度和工艺的可靠性. 仿真结果 μ 表明 ,设计 ADC 的分辨率可达 14 bit ,其 INL 提高2 倍以上 ,功耗 8 . 25 m W . 该设计可利用 0 . 6 m 2 P2M 标准的 CMO S 工艺实现. 关键词 : 积分非线性 ;开关时序 ; 比较器 ;低功耗中图分类号 : TP 432 文献标识码 : A Optimization of Switching Sequence and Its Appl ication in A/ D Converter ZHU Fen g , 　WU Xiaobo , 　 GA O Xiaor u , 　 YAN Xiaolan g ( In stit ut e of VL SI Design , Zhej iang U niver sit y , Hangzhou 3 10027 , China) Abstract :The accuracy of SA R ADC i s u sually limit ed by t he st r uct ure p aramet er error s of it s inner DA C , an d it s low power de sign i s al so an i ssue of great import ance . To reduce t he accumulat ed gradient error s originat ed f ro m t