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2018-03-17 发布于河南
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NF芯片级上电时序图.pdf

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NF芯片级上电时序图

Nivdia芯片组上电相关信号 • PWRGD_SB (I) 电源准备好，DUAL电源稳定后该信号为高电压 SLP_S5#: (O) shutdown （进入STD状态和soft off) MEM__VLD: (I) 指示内存供电已经稳定。 SLPS_S3#: (O) STR功能，除内存供电正常其它供电全关闭 PWRGD： (I) 指示所有主板供电都稳定后为高电位 CPUVDD_EN:(O) 用于控制CPU供电的控制信号（VCORE_EN) CPU_VLD: (I) 指示CPU供电已经稳定 HTVDD_EN: (O) 用于HyperTransport供电控制信号 HT_VLD: (I) 提示HyperTransport供电已经稳定 Nivdia芯片组上电相关信号 LPC_RESET#: (O) resetCK804 内所有设备和LPC设备。 CPU_SLP#: (O) 指示CPU 已经进入C3、C4状态 LPC_PWRDWN#：(O) LPC 电源管理信号，使LPC设备进入节电模式。 • HT_STOP#： (O) 指示HyperTransport断开连接。所有HT连接设 • 备为输入，CK804为控制器 HT_REQ#：（I） HyperTransport总线使用请求信号，C3、C4 状态为唤醒HT通信。 • PE_RST#：（O ）PCI-E的RESET信号 3.3VBAT VCC 、VCC3 1.2V_HT +V_Dual PWRGD HT_VLD XTAL OSC PWRGD_SB CLK LPC_PWRDWN# (H) LAN_CLK SLP_S5(H) CPUVDD_EN 2.5V_SUS VCORE MEM_VLD CPU_VLD SLP_S3(H) HTVDD_EN 开机顺序 PCI_RESET#(L) SLP_S3#(L) HTVDD_EN(L) PWRGD(L) 1.2V_HT(L) VCC 、VCC3 （L） HT_VLD(L) CLK （STOP ） CPUVDD_EN(L) SLP_S5#(L) VCORE(L) 2.5V_SUS(L) CPU_VLD(L) MEM_VLD(L) 关机顺序