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计算机组成原理试题A答案 选择题 1．B 2．C 3．C 4．D 5．B 6．D 7．C 8．C 9. C 10. A 二．填空题 1. A.（38）10 2． A．高速缓冲 B．主存 C．速度 3. A.多 B.一 C.高速 4. A. 二进制代码 B.操作码 C.地址码 5． A．停止CPU访问内存 B． 周期挪用 C．DMA和CPU交替访内 6．A． 阶码 B． 尾数 7．A．操作特性与功能 B．操作数的位置 8. A. 并行 B. 4 C. 数据缓冲 三、解：[ x ]原 = 1.01111 [ x ]补 = 1.10001（1分） 所以 ：[ -x ]补 = 0.01111 （1分） [ y ]原 = 0.11001 [ y ]补 = 0.11001 （1分） 所以 ：[ -y ]补 = 1.00111 （1分） [ x ]补 11.10001 [ x ]补 11.10001 + [ y ]补 00.11001 + [ -y ]补 11.00111 [ x + y ]补 00.01010 [ x - y ]补 10.11000 所以： x + y = +0.01010 （2分） 因为符号位相异，结果发生溢出（2分） 四、解：设最高位为符号位，输入数据为[x]原 = 01111 [y]原 = 11101（1分） 因符号位单独考虑，尾数算前求补器输出值为：|x| = 1111, |y| = 1101（1分） 乘积符号位运算： x0 ⊕y0 = 0⊕1 =1 尾数部分运算： 1 1 1 1 × 1 1 0 1 1 1 1 1 0 0 0 0 1 1 1 1 1 1 1 1 1 1 0 0 0 0 1 1 （2分） 经算后求补器输出，加上乘积符号位，得原码乘积值[x×y] 原 = 111000011 （2分） 换算成二进制真值 x×y = (2 = (-195)10 （2分） 十进制数乘法验证：x×y = 15×(-13) = -195 （2分） 五、解 ：存储器地址空间分布如图1所示，分三组，每组8K×16位。（2分） 由此可得存储器方案要点如下： 组内地址 ：A12 ——A0 （A0为低位）；（2分） 组号译码使用2 ：4 译码器；（2分） RAM1 ，RAM 2 各用两片SRAM芯片位进行并联连接，其中一片组成高8位，另一片组成低8位。（2分） 用 MREQ 作为2 ：4译码器使能控制端，该信号低电平（有效）时，译码器工作。（2分） CPU的R / W 信 号与SRAM的WE端连接，当R / W = 1时存储器执行读操作， 当R / W = 0时，存储器执行写操作。 （2分）如图2 图1 图2 六、 解：该中断系统可以实行5重中断，（1分）中断优先级的顺序是，优先权1最高，主程序运行于最低优先权（优先权为6）。（1分） 图1中出现了4重中断。（1分）中断过程如下：主程序运行到T1时刻，响应优先权4的中断源的中断请求并进行中断服务；（1分）到T3时刻，优先权4的中断服务还未结束，但又出现了优先权3的中断源的中断请求；（1分）暂停优先权4的中断服务，而响应优先权3的中断。（1分）到T4时刻，又被优先权2的中断源所中断，直到T6时刻，返回优先权3的服务程序，（1分）到T7时刻，又被优先权1的中断源所中断，（1分）到T8时刻，优先权1的中断服务完毕，返回优先权3的服务程序，直到T10优先权3的中断服务结束，（1分）返回优先权4的服务程序，优先权4的服务程序到T11结束，最后返回主程序。（1分） 图1中，优先权3的服务程序被中