数电实验报告【武大电气】.docxVIP

  1. 1、本文档共19页,可阅读全部内容。
  2. 2、有哪些信誉好的足球投注网站(book118)网站文档一经付费(服务费),不意味着购买了该文档的版权,仅供个人/单位学习、研究之用,不得用于商业用途,未经授权,严禁复制、发行、汇编、翻译或者网络传播等,侵权必究。
  3. 3、本站所有内容均由合作方或网友上传,本站不对文档的完整性、权威性及其观点立场正确性做任何保证或承诺!文档内容仅供研究参考,付费前请自行鉴别。如您付费,意味着您自己接受本站规则且自行承担风险,本站不退款、不进行额外附加服务;查看《如何避免下载的几个坑》。如果您已付费下载过本站文档,您可以点击 这里二次下载
  4. 4、如文档侵犯商业秘密、侵犯著作权、侵犯人身权等,请点击“版权申诉”(推荐),也可以打举报电话:400-050-0827(电话支持时间:9:00-18:30)。
  5. 5、该文档为VIP文档,如果想要下载,成为VIP会员后,下载免费。
  6. 6、成为VIP后,下载本文档将扣除1次下载权益。下载后,不支持退款、换文档。如有疑问请联系我们
  7. 7、成为VIP后,您将拥有八大权益,权益包括:VIP文档下载权益、阅读免打扰、文档格式转换、高级专利检索、专属身份标志、高级客服、多端互通、版权登记。
  8. 8、VIP文档为合作方或网友上传,每下载1次, 网站将根据用户上传文档的质量评分、类型等,对文档贡献者给予高额补贴、流量扶持。如果你也想贡献VIP文档。上传文档
查看更多
数电实验报告【武大电气】

数字电路实验报告专业:电气工程与自动化实验一:组合逻辑电路分析实验目的熟悉基本逻辑电路的特点。熟悉各类门的实物元件以及元件的使用和线路连接。学会分析电路功能.实验原理利用单刀双掷开关的双接点,分别连接高电平和低电平,开关的掷点不同,门电路输入的电平也不同。门电路的输出端连接逻辑指示灯,灯亮则输出为高电平,灯灭则输出低电平。依次通过门电路的输入电平与输出电平,分析门电路的逻辑关系和实现的逻辑功能。实验元件74LS00D74LS20D实验内容(1)实验内容一:a.实验电路图:由上述实验电路图接线,在开关A B C D选择不同组合的高低电平时,经过对灯X1亮暗的观察,可得出上图的逻辑真值表。b、逻辑电路真值表:ABCDY00000000100010000111010000101001100011111000010010101001011111001110111110111111实验分析:由实验逻辑电路图可知:输出X1==AB+CD ,同样,由真值表也能推出此方程,说明此逻辑电路具有与或功能。(2)实验内容2:密码锁a.实验电路图:分析该密码锁电路的逻辑功能可知:灯泡X1端的输出方程为L=AB’C’D接着通过实验,改变A B C D的电平,观察灯泡亮暗,得出真值表如下: b.真值表:ABCDL00000000100010000110010000101001100011101000010011101001011011000110101110011110实验分析:由真值表(表1.2)可知:当ABCD为1001时,灯X1亮,灯X2灭;其他情况下,灯X1灭,灯X2亮。由此可见,该密码锁的密码ABCD为1001.因而,可以得到:X1=,X2=。五.实验体会:1. 这次实验应该说是比较简单,只用到了两种不同的与非门构成一些基本的逻辑电路。2. 分析组合逻辑电路时,可以通过逻辑表达式,电路图和真值表之间的相互转换已到达实验所要求的目的结果。3. 我们组在此次实验过程中出现过连线正确但没出现相应的实验结果的情况。后经分析发现由于实验器材使用的次数较多,有些器材有所损坏,如一些导线表面是好的,其实内部损坏,因而意识到了连接线路时一是要注意器材的选取,二是在接线前一定注意检查各元件的好坏。实验二:组合逻辑实验(一)半加器和全加器一.实验目的:熟悉几种元器件所带的门电路,掌握用这些门电路设计一些简单的逻辑组合电路的方法。如半加器,全加器,判奇电路等。预习内容:复习用门电路设计组合逻辑电路的原理和方法步骤。2.复习二进制数的运算。3.利用下列元器件完成:A 完成用“异或”门、“与或非”门、“与非”门设计全加器的逻辑图。B 完成“异或”门设计的3变量判奇电路的原理。三.实验元件:1.74LS002.74LS1363.74LS2834.74LS51四.实验内容:1、用与非门组成半加器由理论课知识可知:=====根据上式,设计如下电路图:2、用异或门、与或非门、与非门组成全加器由理论课知识可知:==根据上式,设计如下电路:实验结果如下表所示:被加数数级进位S进位Ci000101113、用异或门设计3变量判奇电路,要求变量中1的个数为奇数时,输出为1,否则为0。根据题目要求可知:输出L=则可以设计出如下电路:实验结果如下表:输入入入入L011010014、“74LS283”全加器逻辑功能测试测试结果如下表:被加数0 1 1 11 0 0 1加数0 0 0 10 1 1 1前级进位0或10或1和1 0 0 0或1 0 0 10 0 0 0或0 0 0 1新进位01五.实验体会:1. 通过本次实验,掌握了半加器与全加器的逻辑功能的运用。2.通过本次试验,深刻认识到了组合逻辑电路设计的多样性,并初步掌握了一些常用的设计组合逻辑电路的方法。3.这次实验的逻辑电路图更为复杂,涉及了异或门、与或非门、与非门三种逻辑门。对应的元器件的引脚图也很容易弄错。特别是74LS51中有两种与或非门,一种是AB+CD取非,另一种是ABC+DEF取非。实验三:组合逻辑实验(二)数据选择器和译码器的应用一、实验目的:熟悉数据选择器和数据分配器的逻辑功能和掌握其使用方法。预习内容:了解所有元器件的逻辑功能和管脚排列,复习有关数据选择器和译码器的内容。用八选一数据选择器产生逻辑函数L=ABC+AB+BC+C和L=ABC用3线——8线译码器和与非门构成一个全加器。三、实验内容:1、数据选择器74LS151的使用设计产生逻辑函数ABC +AB++BC则L=实验电路如下:实验真值表如下:ABCL000000100100011110001011110

文档评论(0)

tmd2017 + 关注
实名认证
文档贡献者

该用户很懒,什么也没介绍

1亿VIP精品文档

相关文档