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4、PCI总线定义 错误报告信号 PERR#：数据奇偶校验错误报告信号。 只报告除特殊周期之外的所有PCI交易期间的数据奇偶错误。其中数据奇偶错误的产生对于在AD总线上驱动地址和数据信息的所有PCI设备都是强制性的。 SERR#：系统错误报告信号。 是报告地址奇偶、特殊周期命令的数据奇偶错误以及其它可能引起灾难性后果的系统错误。 必威体育精装版.课件 * 4、PCI总线定义 仲裁信号（只有主设备具有） REQ#：总线占用请求信号。 信号一旦有效表明驱动它的设备向仲裁器要求使用总线，是一个点到点的信号线。 GNT#：总线占用允许信号。 用来向申请占用总线的设备表示其请求已经获得批准，也是一个点到点的信号线。 必威体育精装版.课件 * 4、PCI总线定义 系统信号 CLK：时钟信号 所有的PCI输入信号的时钟。 其频率范围为0~33MHz或0~66MHz，这一频率称为PCI的工作频率，对于PCI信号，除RST#、INTA#、INTB#、INTC#、INTD#之外，其余信号都是在CLK的上升沿进行采样的。 RST#：复位信号。 用来使PCI专用的特性寄存器、配置寄存器等恢复到规定的初始状态。至于复位后如何变化不属于PCI规范的范围。 复位时，PCI的全部输出一般都驱动到第三态。REQ#和GNT#必须同时驱动到第三态，不能在复位期间为高或为低。 必威体育精装版.课件 * 4、PCI总线定义 中断信号 PCI局部总线中共有四条中断线，分别为INTA#、INTB#、INTC#、INTD#，其作用是用以请求一个中断。但是INTB#、INTC#、INTD#只能用于多功能的PCI卡申请中断时使用。 中断功能是可选设置，电平触发，开漏极 必威体育精装版.课件 * 4、PCI总线定义 附加信号 PRSNT[1﹕2]#：卡存在信号。 由插件板提供的信号，用来指出PCI插卡上是否存在一个插件板，如果存在就为它提供电流。 CLKRUN#：时钟运行信号。 可选信号，作为设备的输入信号，用来确定CLK的状态。 必威体育精装版.课件 * 4、PCI总线定义 64位总线扩展信号 AD[64﹕32]：扩展的32位地址和数据多路复用线。 在地址周期，如果使用了DAC命令且REQ64#有效时，这32条线上含有64位地址的高32位，否则是保留信号；在数据周期，当REQ64#和ACK64#同时有效时，这32条线上含有高32位数据。 C/BE[7﹕4]：扩展总线命令和字节使能多路复用信号线。 REQ64#：64位传输请求信号 由当前主设备驱动，表示本设备要求采用64位通路传输数据。 ACK64#：64位传输认可。 表明从设备将用64位进行传输。 PAR64#：奇偶双字节校验。 必威体育精装版.课件 * 二、PCI总线命令和操作 1、PCI总线命令 2、PCI总线操作时序 必威体育精装版.课件 * 1、PCI总线命令 PCI总线命令概述 总线命令是用来规定主从设备之间的传输类型的，它出现于地址周期的C/BE[3﹕0]线上。当一个主设备获得总线的拥有权时，它就可以启动下表中的任何一种交易类型。在一个交易的地址周期，命令/字节使能总线C/BE[3﹕0]用于表明交易命令和类型。 必威体育精装版.课件 * 1、PCI总线命令 必威体育精装版.课件 * 2、PCI总线操作时序 PCI总线传输协议 PCI总线传输协议是同步传输协议，所有PCI操作均同步于PCI时钟，PCI总线的基本传输规则是突发传输方式。PCI总线传输周期由一个地址周期和一个或多个数据周期构成: 地址周期: 在地址周期，启动设备指定目标设备(在PCI的A/D总线上驱动启动地址)和传输类型(在PCI的C/BE#总线上驱动交易类型命令)，同时发出FRAME#信号表明有效的地址和命令已经在总线上，由于地址周期仅存一拍，所以每个PCI从设备都需要锁存总线上的命令，以供随后译码使用。 数据周期: 启动设备用FRAME#信号来表示突发传输的持续过程。当启动设备准备完成最后一个数据阶段时，需使FRAME#失效且发出IRDY#。最后一个数据传完成之后，启动设备将PCI总线还原至闲置状态(此时，FRAME#和IRDY#均无效)。 必威体育精装版.课件 * 2、 PCI总线操作时序 PCI 突发读操作 必威体育精装版.课件 * 2、 PCI总线操作时序 PCI 突发读操作 必威体育精装版.课件 * 2、 PCI总线操作时序 PCI 突发读操作 必威体育精装版.课件 * 2、 PCI总线操作时序 必威体育精装版.课件 * 2、 PCI总线操作时序 小结 (1)基本的总线传输机制是突发传输，包括一个地址周期和若干个数据周期。 (2)除RST#，INTA#～INTD#之外的所有信号都是在PCI总线时钟上升沿被采样。 (3)PCI总线上所有的数据传输基本上都是由三条信号线控制，即FRAME#、IRDY#和TRDY#。 必威体育精装版.课件 * 2、 PCI总线操作时序 (4)当F