《数字逻辑电路》Lec11 Sequential Logic Analysis and Design.pdfVIP

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数字逻辑电路 Digital Logic Circuit 2011 Spring Lec10 Sequential Logic Design n 1. Synchronous Sequential Circuit Model n 2. Synchronous Sequential Circuit Analysis nn 3.3. SynchronousSynchronous Sequential CircuitSequential Circuit DesignDesign Review: R-S Latch, DFF, JKFF, TFF Review:Sequential Circuits Model Comb X1,X2,X3...X1,X2,X3... Y1,Y2,Y3Y1,Y2,Y3 M1, Mem 1.Synchronous Sequential Circuits Synchronization State Machine 1.Synchronous Sequential Circuits Synchronization: 1. Using the same clock signal Current status: 1.Synchronous Sequential Circuits 1. Store content in memory element represents a state Clocked Synchronous State Machine 2. number of states is limited 3. state transition occurs in the clock edge Memory elements 1.Clk: DFF, JKFF Synchronization: 1. using the same clock signal PDF 文件以 FinePrint pdfFactory Pro 试用版创建 Clocked Synchronous Mealy State Machine 1 control signal for the Output next state, = G (input, current state) Next_state = F (input, current state)state) PDF 文件以 FinePrint pdfFactory Pro 试用版创建

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