SystemVerilog硬件设计及建模—第5章课件.pptVIP

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2017-08-12 发布于河南
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SystemVerilog硬件设计及建模—第5章课件.ppt

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SystemVerilog硬件设计及建模—第5章课件

第5章数组、结构体和联合体;5.1 结构体;5.1.1 结构体声明;5.1.1 结构体声明;5.1.2 结构体赋值;5.1.2 结构体赋值;5.1.2 结构体赋值;5.1.3 压缩和非压缩结构体;5.1.3 压缩和非压缩结构体;5.1.3 压缩和非压缩结构体;5.1.4 通过端口传递结构体;5.1.5 将结构体作为任务和函数的自变量;5.2 联合体;5.2.1 非压缩联合体;5.2.2 标签联合体;5.2.3 压缩联合体;5.2.3 压缩联合体;5.2.3 压缩联合体;5.2.4 综合指导;5.2.5 使用结构体和联合体举例;5.2.5 使用结构体和联合体举例;5.2.5 使用结构体和联合体举例;5.3 数组;5.3.1 非压缩数组;5.3.1 非压缩数组;5.3.2 压缩数组;5.3.2 压缩数组;5.3.4 数组声明时的初始化;5.3.4 数组声明时的初始化;5.3.5 数组赋值;5.3.5 数组赋值;5.3.6 数组复制;5.3.6 数组复制;5.3.7 使用位流转换复制数组和结构体;5.3.8 由数组构成的数组;5.3.9 数组中使用用户自定义类型;5.3.10 数组通过端口、任务与函数传递;5.3.10 结构体、联合体与数组;5.3.13 综合指导;5.3.14 数组应用实例;5.3.14 数组应用实例;5. 4 foreach循环;5. 5 用于数组查询的系统函数;5. 5 用于数组查询的系统函数;5. 6 $bits位宽系统函数;5. 8 小结