改进bm算法的高速rs译码器方案及其fpga实现 a high-speed rs decoder using extended bm algorithm based on fpga.pdfVIP

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2017-08-13 发布于上海
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改进bm算法的高速rs译码器方案及其fpga实现 a high-speed rs decoder using extended bm algorithm based on fpga.pdf

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改进bm算法的高速rs译码器方案及其fpga实现 a high-speed rs decoder using extended bm algorithm based on fpga

丽器件与电路酽囿稍舄囿响圈@6旷@凹6℃ 文章编号：1002—8684(2007)06—0022—05 改进BM算法的高速RS译码器 ·论文· 方案及其FPGA实现郑文杰，李磊，冯穗力，叶梧 (华南理工大学电子与通信工程系，广东广州510641) 【摘要】介绍了一种高速的RS译码器的结构方案。由于一般BM算法的实现结构不规则，以及延时过长的缘故，在VLSI的设计中，广泛采用的是eE算法，采用的改进BM算法，使得BM算法的实现结构规则，并且延时更小。另外还采用了一种新的有限域乘法结构，有规则的结构，易于HDL语言实现。【关键词】前向纠错；RS码；有限域乘法器；BM算法【中图分类号】TN91 【文献标识码】A A RSDecoderExtendedBM BasedonFPGA High-Speed Using Algorithm ZHENG Wu Lei，FENGSui-li，YE Wen-jie，LI ofElectronicsandCommunication China of UniversityTechnology，Guangzhou (Department Engineering，South architectureis is andhas 【Abstract】A RS(Reed—Solomon)decoder high—speed presented．BMalgorithmirregular a critical whichis onthe ofthecode．Anarchitecture longer pathdelay dependenterror-correctingcapability for ofthe basedonthe isusedinthe ofthe thesake eE(extended implementations Euclidean)algorithmmajority architecturesinBM architecturebasedonamodifiedBM is andhasless irregular algorithm．An algorithmregular critical newGF architectureis for architecture． pathdelay．Finally，amultiplied adoptedregular words】FEC；Reed-solomencodes；GF 【Key multiplier；Berle