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重庆邮电大学光电工程学院
EDA课程设计报告
三态总线电路设计
蒋锐
2011-5-12
系统方案
三态总线电路可在两总线之间双向传输数据：从总线A到总线B
或总线B到总线A。为组成芯片的总线系统，必需设计三态总线驱动
器电路，如图一。在三态总线驱动器电路内部由三态缓冲器方向选择
性地传输每位数据，所谓三态即高电平、低电平及高阻。
图一三态总线驱动器电路
本方案利用不反向、高电平使能三态缓冲器，如图二。当en为
高电平常in传输到out，当en为低电平常in不能传输到out，out表
现为高阻。三态器件请许诺多个信号源共享单个“同线”，条件是线
上每次只有一个器件被开启。
en
inout
图二不反向、高电平使能三态缓冲器
三态总线驱动器是总线中的关键器件，本方案同时利用了原理图
输入和VHDL语言描述的方式来设计三态总线驱动器，可进一步组成
三态总线电路。本方案要紧设计了单
通道总线，如需要拓展成多通道，可在原理图中加入相同的部件，
或在VHDL代码中加入多个并行进程即可。
系统功能框图
在图中三态总线驱动器在两总线间起双向收发作用。其操作
模式为：
EN=‘0’，DIR=‘0’，从B到A传输数据；
EN=‘0’，DIR=‘1’，从A到B传输数据；
EN=‘1’，DIR=‘X’，在B主A是独立传输数据。
BUSA
EN
控制
电路三
DIR态
总
线
驱
动
器
BUSB
图三系统功能框图
原理图
图中利用8对三态缓冲器别离作为8位数据传输通道，由DIR
决定传输方向，由EN决定是不是传输数据。
图四原理图
图五原理图的综合结果
VHDL源代码
libraryIEEE;
usetri_state_bus2is
port(a:inoutstd_logic_vector(1to8);
b:inoutstd_logic_vector(1to8);
en,dir:instd_logic
);
endtri_state_bus2;
architecturebehavoftri_state_bus2is
begin
process(a,b,dir,en)
begin
if(dir=1)and(en=0)then
b=a;
else
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