实验报告——多路选择器设计.docVIP

下载本文档

97
0
约小于1千字
约 6页
2020-03-14 发布于河北
举报
版权申诉

实验报告——多路选择器设计.doc

1、有哪些信誉好的足球投注网站（book118）网站文档一经付费（服务费），不意味着购买了该文档的版权，仅供个人/单位学习、研究之用，不得用于商业用途，未经授权，严禁复制、发行、汇编、翻译或者网络传播等，侵权必究。。
2、本站所有内容均由合作方或网友上传，本站不对文档的完整性、权威性及其观点立场正确性做任何保证或承诺！文档内容仅供研究参考，付费前请自行鉴别。如您付费，意味着您自己接受本站规则且自行承担风险，本站不退款、不进行额外附加服务；查看《如何避免下载的几个坑》。如果您已付费下载过本站文档，您可以点击这里二次下载。
3、如文档侵犯商业秘密、侵犯著作权、侵犯人身权等，请点击“版权申诉”（推荐），也可以打举报电话：400-050-0827(电话支持时间：9:00-18:30)。
4、该文档为VIP文档，如果想要下载，成为VIP会员后，下载免费。
5、成为VIP后，下载本文档将扣除1次下载权益。下载后，不支持退款、换文档。如有疑问请联系我们。
6、成为VIP后，您将拥有八大权益，权益包括：VIP文档下载权益、阅读免打扰、文档格式转换、高级专利检索、专属身份标志、高级客服、多端互通、版权登记。
7、VIP文档为合作方或网友上传，每下载1次，网站将根据用户上传文档的质量评分、类型等，对文档贡献者给予高额补贴、流量扶持。如果你也想贡献VIP文档。上传文档

工学院实验报告 PAGE 1 姓名：黄娟学号班级：自动141 成绩：实验名称：多路选择器的设计实验目的 1. 掌握EDA工具Quartus Ⅱ的使用； 2. 掌握Verilog编程技术。 3. 掌握Quartus Ⅱ的文本输入设计流程。 4. 掌握二选一多路选择器和四选一多路选择器的Verilog表述。二、四选一多路选择器的Verilog表述（case）（1）case语句表述方式 module CNT10(a,b,c,d,s1,s0,y); input a,b,c,d; input s1,s0; output y; reg y; always @(a or b or c or d or s1 or s0) begin : CNT10 case ({s1,s0}) 2b00:y=a; 2b01:y=b; 2b10:y=c; 2b11:y=d; default :y=a; endcase end Endmodule 波形仿真 RTL图三、四选一多路选择器的Verilog表述（if） if语句表达方式 module CNT10(A,B,C,D,S1,S0,Y); input A,B,C,D,S1,S0; output Y; reg [1:0] SEL; reg Y; always @(A,B,C,D,SEL) begin SEL = {S1,S0}; if(SEL==0)Y=A; else if(SEL==1)Y=B; else if(SEL==2)Y=C; else Y=D; end endmodule 波形仿真 RTL图注意事项文件名必须和模块名保持一致，文件路径中不要有汉字，一开始没有注意，存在了桌面上，并且文件名用了汉字而调试好长时间，最后经过老师指点才完成！实验前熟悉了数据选择器的工作原理，实验过程中结合理论进行了分析，并且初步掌握了QuartusⅡ 环境下4选1数据选择器的Verilog HDL语言设计以及原理图的设计。在进行波形仿真时，我们遇到了一些问题，刚开始的时候，不懂得怎么调整时序时间，在老师和同学的帮助下，顺利的解决了遇到的问题，