上拉、下拉及0欧姆电阻的作用.docVIP

上拉、下拉电阻的作用 在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。 1 电阻作用：  接电阻就是为了防止输入端悬空  减弱外部电流对芯片产生的干扰  保护cmos内的保护二极管,一般电流不大于10mA 上拉和下拉、限流 1. 改变电平的电位，常用在TTL-CMOS匹配 2. 在引脚悬空时有确定的状态 3. 增加高电平输出时的驱动能力 4. 为OC门提供电流  那要看输出口驱动的是什么器件，如果该器件需要高电压的话，而输出口的输出电压又不够，就需要加上拉电阻。  如果有上拉电阻那它的端口在默认值为高电平你要控制它必须用低电平才能控制如三态门电路三极管的集电极，或二极管正极去控制把上拉电阻的电流拉下来成为低电平。反之，尤其用在接口电路中,为了得到确定的电平,一般采用这种方法,以保证正确的电路状态,以免发生意外,比如,在电机控制中,逆变桥上下桥臂不能直通,如果它们都用同一个单片机来驱动,必须设置初始状态.防止直通! 2、定义： 上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！ 上拉是对器件注入电流，下拉是输出电流 弱强只是上拉电阻的阻值不同，没有什么严格区分 对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。 3、为什么要使用拉电阻： 一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。 数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！ 一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平，C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗： 比如：当一个接有上拉电阻的端口设为输状态时，他的常态就为高电平，用于检测低电平的输入。 上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的电阻在选用时，选用经过计算后与标准值最相近的一个！ P0为什么要上拉电阻原因有： 1. P0口片内无上拉电阻 2. P0为I/O口工作状态时，上方FET被关断，从而输出脚浮空，因此P0用于输出线时为开漏输出。 3. 由于片内无上拉电阻，上方FET又被关断，P0输出1时无法拉升端口电平。 P0是双向口，其它P1，P2，P3是准双向口。 准双向口是因为在读外部数据时要先“准备”一下，为什么要准备一下呢？ 单片机在读准双向口的端口时，现应给端口锁存器赋1，目的是使FET关断，不至于因片内FET导通使端口钳制在低电平。 上下拉一般选10k！ 芯片的上拉/下拉电阻的作用 最常见的用途是,假如有一个三态的门带下一级门.如果直接把三态的输出接在下一级的输入上,当三态的门为高阻态时,下一级的输入就如同漂空一样.可能引起逻辑的错误,对MOS电路也许是有破坏性的.所以用电阻将下一级的输入拉高或拉低,既不影响逻辑又保正输入不会漂空. 改变电平的电位，常用在TTL-CMOS匹配； 在引脚悬空时有确定的状态； 为OC门的输出提供电流； 作为端接电阻； 在试验板上等于多了一个测试点，特别对板上表贴芯片多的更好，免得割线； 嵌位； 上、下拉电阻的作用很多，比如抬高信号峰峰值，增强信号传输能力， 防止信号远距离传输时的线上反射，调节信号电平级别等等！当然还有其他的作用了具体的应用方法要看在什么场合，什么目的，至于参数更不能一概而定，要看电路其他参数而定，比如通常用在输入脚上的上拉电阻如果是为了抬高峰峰值，就要参考该引脚的内阻来定电阻值的！另外，没有说输入加下拉，输出加上拉的，有时候没了某个目的也可能同时既有上拉又有下拉电阻的！ 加接地电阻－－下拉 加接电源电阻－－上拉 对于漏极开路或者集电极开路输出的器件需要加上拉电阻才可能工作。另外，普通的口，加上拉电阻可以提高抗干扰能力，但是会增加负载。 电源：+5V 普通的直立LED共八个，负极分别接到一个大片子的管脚上，用多大的上拉电阻合适？ 一般LED的电流有几个mA就够了，最大不超过20mA，根据这个你就应该可以算出上拉电阻值来了。 保献起见，还是让他拉吧，(5-0.7)/10mA=400ohm,差不多吧,不放心就用2k的 奇怪，新出了管压0.7V的LED了吗？据我所知好象该是1.5V左右。我看几百