一种CMOS异或门的版图优化设计方法-计算机工程与科学-兰州交通.PDFVIP

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2018-11-27 发布于天津
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一种CMOS异或门的版图优化设计方法-计算机工程与科学-兰州交通.PDF

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一种CMOS异或门的版图优化设计方法-计算机工程与科学-兰州交通

27 1 Vol. 27 No. 1 2008 2 Journal of Lanzhou Jiaotong University Feb. 2008 : 1001- 373(2008) 01-0107-03 * CM OS 刘春娟, 吴蓉 ( , 730070) : 通过对异或门的各种特性进行较完整的分析研究, 从CMOS 异或门电路级晶体级以及版图级的逐级设计, 提出了一种异或门的版图优化设计方法. 并且使用IC 设计工具 T anner Pro 对异或门电路和版图进行了仿真和与优化. 通过仿真试验, 验证了所设计的CMOS 0. 65m N 阱工艺参数的版图在结构上得到了简化, 平均延迟传递时间为tavd = 0. 67 ns, 性能上获得了改善. : CMOS; 异或门; 版图设计; Tanner : T N 32 : A CM OS , , , , . . , , , , , CM OS [ 1] , . , , , , a b = ab + ab = ab + ab = a + b + a + b ( 2) , A OI . [ 2] . , , 2 3 , . CM OS , . 2 CMOS Tanner , , CM OS 0. 15 m N , , [ 3] . CMOS : , . P M OS 1 CM OS ; N . 1 : ( 2) a, b , 0; a, b . , Z= a b. [ 3] , 1 . 3 CMOS a b = ab + ab ( 1) CM OS M OS , N CM OS P CMOS , CM OS . N CM OS NM OS * : 2007- 10-12 : ( 1973- ) , , , , . 108