面积优化的正交dds软核编译器设计与实现 design of an area efficient quadrature dds ip compiler.pdfVIP

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2017-08-22 发布于上海
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面积优化的正交dds软核编译器设计与实现 design of an area efficient quadrature dds ip compiler.pdf

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面积优化的正交dds软核编译器设计与实现 design of an area efficient quadrature dds ip compiler

第48卷第5期也讥技求 V01．48No．5 Telecommunication May2008 2008年5月 Engineering 文章编号：1001—893X{2008)05-0036一04 面积优化的正交DDS软核编译器设计与实现宰于金刚，杜伟韬 (中国传媒大学广播电视数字化工程中心，北京io0024) 摘要：为了使直接数字频率合成器(DDS)的m设计达到资源和效率的较好平衡，提高此类IP设计的灵活性和重用性，应用泰勒插值方法对ROM进行压缩，设计并实现了一种自动生成正交DDS 软核的编译器。文中推导了正交DDS内部信号关键参数设定公式，描述了IP编译器的设计流程，给出了实验结果。关键词：直接数字频率合成器；泰勒插值；IP编译器；FPGA；面积优化中图分类号：TN74；TN762文献标识码：A AreaEfficient DDSIP ofan Quadrature Design Compiler YU Wei—tao fin—gang，DU andCommunicationof University 100024，China) (DigitMEngineeringCenter，Media China，Beijing balancebetween andcircuitareainDDSIP incon— achieveabetter Abstract：To performance core，also siderationofthe and ofIP is tocorn— flexibilityreusabilitydesign，Taylorinterpolationtechniqueadopted 8nIP isrealized．The ofthe inhardwarearchi— theROMofDDSand press compiler keyalgorithmsignals tectureof andthe ofHDLcodeauto aredescribedindetailandthede- DDS quadrature principle generator fitswell． signresults玳provided efficient Keywords：DDS；Taylorinterpolation；IPcompiler；FPGA；area 号线位宽、ROM尺寸以及流水线级数都可能发生变 1 引言化。上述情况下，现有IP设计的重用性可能不够，