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西南交大EDA期末报告
EDA实验报告
班级：微电子2班
指导老师：XXXX
学号：XXXXXXXXXX
姓名：XXX
A)stp
B)5959
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
use ieee.std_logic_unsigned.all;
USE work.licipher_5959_99_pkg.ALL;
ENTITY licipher_updown_5959_text IS
PORT
(clk : IN STD_LOGIC;
res_in : IN STD_LOGIC;
ena_in : IN STD_LOGIC;
cout_final : OUT STD_LOGIC;
hex0 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
hex1 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
hex2 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
hex3 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
hex4 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
hex5 : OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
cipher_in: IN STD_LOGIC_VECTOR(7 DOWNTO 0)
);
END licipher_updown_5959_text;
ARCHITECTURE bdf_type OF liucipher_updown_5959_text IS
SIGNAL clk_100hz_clk_cnt10_0 : STD_LOGIC;
SIGNAL clk_cnt10_1 : STD_LOGIC;
SIGNAL clk_cnt10_2 : STD_LOGIC;
SIGNAL clk_cnt10_4 : STD_LOGIC;
SIGNAL clk_cnt6_3 : STD_LOGIC;
SIGNAL clk_cnt6_5 : STD_LOGIC;
SIGNAL seg7_m0 : STD_LOGIC_VECTOR(3 DOWNTO 0);
SIGNAL seg7_m1 : STD_LOGIC_VECTOR(3 DOWNTO 0);
SIGNAL seg7_m2 : STD_LOGIC_VECTOR(3 DOWNTO 0);
SIGNAL seg7_m3 : STD_LOGIC_VECTOR(3 DOWNTO 0);
SIGNAL seg7_m4 : STD_LOGIC_VECTOR(3 DOWNTO 0);
SIGNAL seg7_m5 : STD_LOGIC_VECTOR(3 DOWNTO 0);
BEGIN
b2v_inst : hsu_div_to_100
GENERIC MAP(N = 500000
)
PORT MAP(clk = clk,
outclk = clk_100hz_clk_cnt10_0);
b2v_inst1 : hsu_count10_updown
PORT MAP(CLK = clk_100hz_clk_cnt10_0,
RST = res_in,
ENA = ena_in,
COUT = clk_cnt10_1,
OUTY = seg7_m0,
cipher=cipher_in);
b2v_inst10 : hsu_2011am_seg7
PORT MAP(data_in = seg7_m3,
q_out = hex3);
b2v_inst11 : hsu_2011am_seg7
PORT MAP(data_in = seg7_m4,
q_out = hex4);
b2v_inst12 : hsu_2011am_seg7
PORT MAP(data_in = seg7_m5,
q_out = hex5);
b2v_inst2 : hsu_count10_updown
PORT MAP(CLK = clk_cnt10_1,
RST = res_in,
ENA = ena_in,
COUT = clk_cnt10_2,
OUTY = seg7_m1,
cipher=cipher_in);
b2v_inst3 : hsu_count10_updown
PORT
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