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DDR2 仿真说明 heroedit@ Ver0.0/2006-9-30 QQ 信号完整性群：3488655 --谨以此文献给初学SI 的艰苦岁月 写此文的初衷是整理下仿真的思路，给那些和我曾经一样苦苦挣扎在仿真边 缘的人一点经验，与SI 同行。 论坛上经常可以看到不少人看 design guide 而不知道 design guide 怎么来 的，以及为什么有那么都走线关系等。实际上design guide 是根据仿真以及经验 整理出来，因此希望此文能回答一些基本问题。 本文难免有些错误或者考虑不周，随时欢迎进行讨论并对其进行修改！ 概要 本文大部分是基于DDR2 Spec 的理解并进行解释，包括很多时序图，因而 很多细节问题需要参考DDR2 spec 。DDR2 的spec 在目前必威体育精装版版本是jesd79-2c 可在/download/search/JESD79-2C.pdf 下载到，做仿真仿真，我觉得首 先要把仿真时序部分先弄清楚，那么仿真的事情已经完成一半。讨论几个概念 仿真工具的使用 Cadence pcb si: 板级仿真软件，时序计算比较方便 Synopsys Hspice: 晶体管级仿真软件，差分线仿真感觉精确度比pcb si 好点 Ansoft HFSS: 三维电磁场仿真软件，提取过孔模型等 DDR2 工作方框图 在子卡定义的时候经常有single rank 以及dual rank 的区分，从仿真角度来看， 如果一个数据线带2 个SDRAM，那么认为是double rank 不妨来看下DDR2 sodimm 的Raw card A 定义，它是dual rank，原因在于，Raw card A 采用的SDRAM 是X16 ，而且Raw card A 上面有8 个SDRAM，而sodimm 的架构是X64 ，因而每根数据线连到16X8/64=2 SDRAM 仿真频率（Switching frequency ）的选择 通常大家对于仿真频率选择有点迷糊，特别是 DDR2 产品，比如说定义 DDR2 的数据传输为667 MT/s，那么Clock/data/cmd/ctl 的仿真频率如何选择，不妨看 下面的时序图 考虑Clock 时钟，他一个周期比如说T0 它包含2 个bit01 信息，对于DDR2 667 来说bit 数据流667Mbit/s，实际仿真的频率为333MHz 考虑Address/CMD ，在此是1T，通过时序图可以看到，它是clock 时钟的一半， 仿真的频率为 167MHz，因而可以得到下面的仿真频率 Clock 333MHz 、Data 333MHz、Control 167MHz、Address/Cmd 167MHz(1T) 83(2T) 。同理对于pcie 类 似的2.5Gbit/s ，他们仿真频率为1.25GHz 仿真DDR2 的类型 通常在主板设计中可能用到如下的 DDR2 类型：直接在板上用 SDRAM 芯片； 使用dimm （DIMM 大部分用在台式机上面) ；使用sodimm （sodimm 大部分用在 笔记本电脑等上面）。实际上DIMM/SODIMM 只是种规格，相当于插卡，插卡 板上采用DRAM 芯片，对于仿真来说，它们只不过是多板仿真，接口不同而已。 以下几点特别提出来，因为在仿真的时候，有可能碰到，虽然大同小异 a. 带ECC 功能的DDR2 以及不带ECC 功能的DDR2 ，相当于多出来一组数据线， 不过他不是用来传输数据，而是用来检测数据的有效性 b. 带Register 功能的DDR2 以及不带Register 功能的DDR2 ，由于ADDR 带的 负载比较重，所以在插卡上加个register(buffer)来重新驱动 addr，因而计算公式 有些差异，但是仿真方法思路一致，在此不对于其进行赘述 具体大家可以去 查询，还有可去下载JEDEC 给出board file ， 大家可以进行对比。 ODT （on die termination ）的概念 大家如果用过 DDR 会记得板上数据线后经常有个尾巴（56Ohm