电子电路设计训练（北航）Exp 2014 Verilog 03.pptVIP

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2017-05-14 发布于浙江
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电子电路设计训练（北航）Exp 2014 Verilog 03.ppt

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北航· 电子信息工程学院 Verilog设计 * 实验四电子电路设计训练数字部分（Verilog） * 目的1: （温故）：明确区分阻塞赋值与非阻塞赋值目的2: （知新）：掌握同步状态机设计方法内容：练习四、阻塞赋值与非阻塞复制的区别（包含后面的思考题）练习八、利用有限状态机进行时序逻辑设计的练习题（只作练习题）练习九、利用状态机实现比较复杂的接口设计的正文（暂时不作其练习题）地点：新主楼F535；时间：下周二(4-15日下午16、17点): 27、28班下周四(4-17日晚19、20、21点): 21、22班+27、28排不下下周日(4-20日下午14、15、16、17点): 23、24班+21班排不下下周日(4-20日晚19、20、21点): 25、26班+22班排不下第三次实验 * 联系方法李峭、何锋 avionics@buaa.edu.cn robinleo@buaa.edu.cn 010新主楼 F710 202教研室——航空电子与总线通信实验室 Avionics and Bus Communications Laboratory(ABC Lab) * * *