Cadence布线规则设置检查..docVIP

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2016-12-28 发布于重庆
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Cadence布线规则设置检查..doc

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Cadence布线规则设置检查（软件版Cadence 16.6）用Cadence布完线的PCB文件检查它的布线规则，可以快速有效地了解布线情况，这里我们应用的是Cadence 16.6版本软件，这里用Allegro PCB Planner打开drd文件如图3和图4所示，点击Setup选择Constrains，点击第二项Electrical如图5所示，进入Allegro PCB Planner界面如图6 图3 图4 点击Setup选择Constrains，点击第二项Electrical如图5所示，进入Allegro PCB Planner界面如图6 图5 图6 这里我们主要关心NET选项下边的后两项Differential Pair和Relative Propagation Delay，前一个是差分对布线的规则设置情况，后一个可以查看具体布线的线长和延时信息。图7 这里选择Differential Pair，查看差分对的规则设置，鼠标右键单击PCB文件名（这里是XXH14a2）然后左键单击Analyze如图8，得到图9 图8 这里我们只看图9中的Static Phase这一栏，这一栏中的Tolerance和Margin这两项有数据就表示对左边Name栏中差分对信号做了约束。Tolerance值为允许的差分对两个成员网络的长度差。图9 选择Relative Propagation Delay，查看差分对的规则设置，鼠标右键单击PCB文件名（这里是XXH14a2）然后左键单击Analyze如图10，得到图11 图10 图11中length一列对应的数值就是具体信号线布线的长度信息，可以根据之前的布线要求进行核对，主要看同一组数据线布线长度差值是否过大，要求的等长度布线是否符合要求等。图11