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2017-08-14 发布于安徽
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高性能容错处理核心地研究.pdf

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(1Fw．8沦史榘高性能容错处理核心的研究 rf：强袁由光 (中船总七院匕0九研究所湖北省武汉市74223信箱四分梧430074) 稿薹本文提出了以二i模冗余衷决为琏础构造容错处理恢心的疗案。’：个cI，u模块采取松散同步的形式．只有在发乍总线操作时才进行同步表决。在处弹核心中采用了两级故障榆测机制，以=i模表决器作为第‘级来保nE处理核心有足够离的故障覆盖率；以CPU模块的臼榆作为第：级来弥补表决器发现故障延迟的不足，缩匏l故障的辩幸伏时问。在表决器的设计中采取r表决器旁路及先编码、，i表决的方法。先用编码的方式提取需要表决的数据的特征，然后对苴特征蚂进行表决。前次采用先进的边界引描技术蛮现了以危打扰的方式完成CPU模块的故障检测。美曩饲j三镶冗余囊决鬻故障梭蔫边界扫描绩码松散陶步 THERESEARCHOFHIGHPERFOR—U婚ICE FAULT-TOL暮从NTPROCESSINGCORE WangQiang (WuhanDigitalEngineeringInstitute) P0．Box74223．Wuhan．Hubei．China，430074 AbstractThearticle based Modularreduodant presents她schemeOF／Triple voting细 constructthefault—tolerator corc．ThreeCPUmodulesarg,loose processing synchronizatlon．They andthenvote whenthereisbus the author synchronize only operation．Inprocessingcore，the HSCStwoleveloffault mechanism．TheModularvoteristhefirstlevelto detecting Triple promise the fault module’s core enoughhiglI rate．TheCPU self-testisthe processinghaving coverage secondlevel．anditsfunctionistofindfaulte日rliefandreducethefault’Blatenttime．Thevoteris Oilthesideroadand dataisfirstencodedandthenvoted．After the deigned the extn∞ting ofthedata．the codeswillbevoted．TheCPUmodule’sfauRisdetectedinno- signature signature for fwst withtheadvanced scall disturb the time boundary way technoloib． Modnlar fault KeyWord：Tripleredundancy,votendeteefioa，bouadaryScan，encode，loose synchronization (。)概述进入九十年代以来，汁算机网络技术飞速发腱，