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本发明涉及芯片设计领域，尤其涉及一种适用于芯片布线的连通图生成方法。对于给定的引脚位置坐标及源引脚，本发明使用策略网络对输入的所有引脚位置坐标进行编码处理，并在解码过程中迭代预测新的枢纽引脚，将源引脚、枢纽引脚及所有引脚的位置坐标信息作为MSPD算法的输入数据生成斯坦纳树形成连通图。与此同时，本发明还使用价值网络对策略网络选择的枢纽引脚的质量进行评估。本发明利用强化学习和MSPD算法，显著提高了优化平衡芯片布线中总线长度与倾斜值的效率，减少了计算资源的消耗和优化过程的时间。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117829085A
(43)申请公布日2024.04.05
(21)申请号202410240283.0
(22)申请日2024.03.04
(71)申请人中国科学技术大学
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