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本发明涉及一种基于进位保留加法器的模加模减加速装置及加密设备,模加模减加速装置包括模加加速模块和模减加速模块;模加加速模块通过三级级联的数据压缩电路对输入的加数和加数进行以数值P为模的相加输出模加结果,其中第一级数据压缩电路采用四输入CSA单元进行模加压缩处理,第二、三级数据压缩电路利用三输入CSA单元进行模加压缩处理;模减加速模块对减数进行按位取反后再通过四级级联的数据压缩电路对输入的被减数和取反后的减数进行以数值P为模的相加输出模减结果,其中第一级数据压缩电路采用四输入CSA单元进行模加压缩
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117313113A
(43)申请公布日2023.12.29
(21)申请号202210727624.8
(22)申请日2022.06.22
(71)申请人数据通信科学技术研究所
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