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一种成像系统及像素合并方法,成像系统包括多个像素单元构成的像素阵列、控制电路、读出电路和功能逻辑控制单元,相邻三列中的三个相邻像素单元中的第一像素组成像素单元块,相邻三列中的三个相邻像素单元中的第四像素组成像素单元块,第m行中最靠近的三个第二或第三像素、第m+1行和第m‑1行中与第m行中该三个第二或第三像素中的中间一个像素均对角相邻的第二或第三像素以及第m+2行、第m‑2行中与第m+1行和第m‑1行的该两个像素均对角相邻的第二或第三像素组成像素单元块。本发明的成像系统及像素合并方法中,由于像素单
(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113141475 A (43)申请公布日 2021.07.20 (21)申请号 202010053452.1 (22)申请日 2020.01.17 (71)申请人 思特
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