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本申请公开了一种输出延迟线及延迟锁相环，该输出延迟线由多个延迟块组成，每个延迟块包括可配置的粗调延迟线和精调延迟线，粗调延迟线和精调延迟线根据配置选择信号选择单位延迟，使得延迟时间参数与配置选择信号相匹配，实现满足不同频段下所需的延迟锁相环的延迟时间的目的，能够支持ONFI4.2国际协议定义的所有时间模式。另外，基于输出延迟线的延迟锁相环具有良好的可扩展性，除了能够满足当前ONFI4.2国际协议中规定的全部时序模式要求之外，还能覆盖更宽的频率范围，满足未来发展要求。进一步的，本申请实施例提供
(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112511158 A (43)申请公布日 2021.03.16 (21)申请号 202011460683.0 (22)申请日 2020.12.11 (71)申请人 中国科学院微电子研究所
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