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本发明公开了一种集成电路的时钟网络抽取方法、装置及其存储介质，属于电路设计领域。该方法主要包括：确定时钟网络的推导起点节点；持续逆向推导所述时钟网络的上一个节点，得到所述时钟网络的推导过程节点以及确定所述时钟网络的推导终点节点三个步骤。本发明可以简单高效，在不依赖电子设计自动化工具前提下，清晰准确地剥离特殊的起点和终点，进一步将任意类型的时钟网络架构整个剥离出来，并且避免了回溯的问题，从而便于设计工程师对时钟网络进行质量分析和优化，高效解决集成电路时时钟有效传播的问题。
(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112231998 A (43)申请公布日 2021.01.15 (21)申请号 202011097264.5 (22)申请日 2020.10.14 (71)申请人 北京百瑞互联技术有限公司
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