数字超大规模集成电路设计 (85).pdfVIP

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2022-12-18 发布于陕西
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数字超大规模集成电路设计 (85).pdf

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7.4.4 动态逻辑的功耗 27 功耗优点缺点 •实际电容小—— •时钟功耗晶体管少，每个扇出的负载只有一个晶体管 •无毛刺 28 动态电路的开关活动性动态逻辑门当输出为0时，在下一个周期就需要进行充电，因此开关活动性=输出为0的概率(p0)。静态电路的开关活动性： α → = p p 0 1sta 0 1 动态电路的开活动性： α0→1dyn = p 0 29 功耗优点缺点 • 实际电容小——晶 • 时钟功耗体管少，每个扇出 • 开关活动性高的负载只有一个晶 • 当增加抗漏电器件体管时可能会有短路电 • 无毛刺流（见后面部分) 总体上，动态电路的功耗高于静态互补CMOS逻辑。 30 动态逻辑的动态特点要求一系列的周期性预充和求值，纯粹的静态分析不再适用 • 输入只允许在预充电阶段变化，在求值阶段必须保持稳定 • 输入最多只能有一次低至高的过渡开关速度快需要预充电/求值时钟，时钟是一个全局信号，往往有很大的负载。只有动态功耗，无静态功耗,总功耗通常高于静态CMOS 31