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2018-04-06 发布于天津
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低延迟以太网10gmac用户指引

低延迟以太网 10G MAC 用户指南 Altera 完整设计套件的最后更新: 14.0 订阅 UG-01144 101 Innovation Drive 2014.06.30 San Jose, CA 95134 反馈内容关于本 IP 内核1-1 特性1-1 发布信息1-2 器件系列支持 1-3 性能和资源利用1-3 发送和接收延迟1-4 入门 2-1 Altera IP 内核的简介 2-1 安装 IP 内核和为其获得许可 2-1 指定IP 内核参数和选项2-2 参数化该 IP 内核 2-2 参数设置2-3 生成的文件 2-4 在其它EDA 工具中仿真Altera IP 内核2-5 从以太网 10G MAC 移植到 LL 以太网 10G MAC 2-6 移植— Avalon-ST 上的 32 位数据路径 2-6 移植—在 Avalon-ST 上保持 64 位 2-7 升级过时的IP 内核2-7 移植过时的 IP 内核2-8 功能说明 3-1 体系结构3-1 接口3-2 帧类型 3-3 发送数据路径 3-4 插入填充字节 3-4 插入地址3-4 插入 CRC-32 3-4 XGMII 封装3-6 生成和插入数据包间的间隙3-7 XGMII 发送3-7 单向特性3-8