CDCE62005锁相环电路设计与应用-德州仪器.PDFVIP

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2018-02-28 发布于天津
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CDCE62005锁相环电路设计与应用-德州仪器

Application Report Lit. Number – Month Year CDCE62005 锁相环电路锁相环电路设计与应用设计与应用锁相环电路锁相环电路设计与应用设计与应用 Steven Shi China Telecom Application Team 摘摘要要摘摘要要 CDCE62005 是一个内置高性能 VCO 的时钟锁相环，具有非常好的相位噪声性能（均值抖动1ps@10KHz-- 20MHz ），可通过 SPI 接口配置不同的分频系数、电流增益及部分的电阻电容值选择等，电路设计中可灵活地改变环路参数，以满足不同应用系统的需求。本文通过介绍 CDCE62005 的工作特点，分析如何优化设计 CDCE62005 锁相环电路。通过把环路简化为二阶和三阶模型，在获得最佳的锁相环性能下推算环路参数和元器件参数之间的关系，并对实际 4 阶的 CDCE62005 锁相环电路进行仿真分析和实验测试，证明该简化是正确。目目录录目目录录 11 概述概述 3 11 概述概述 22 CDCE62005CDCE62005 介绍介绍 3 22 CDCE62005CDCE62005 介绍介绍 2.1 工作原理 3 2.2 CDCE62005 器件特点 4 33 CDCE62005CDCE62005 锁相环电路分析锁相环电路分析 5 33 CDCE62005CDCE62005 锁相环电路分析锁相环电路分析 3.1 环路参数与元器件参数 5 3.2 噪声模型 8 3.3 设计步骤 9 44 CDCE62005CDCE62005 锁相环电路设计锁相环电路设计 10 44 CDCE62005CDCE62005 锁相环电路设计锁相环电路设计 4.1 获取元器件参数 11 4.2 仿真分析 11 4.3 实验测试 13 55 总结总结 13 55 总结总结 66 参考资料参考资料 14 66 参考资料参考资料图图图图 1 CDCE62005 内部框图3 2 4 阶 2 型锁相环电路模型4 3 最佳稳定系统的环路相位裕量与开环 0dB 带宽6 4 锁相环噪声模型7 5 典型锁相环噪声传递特性8 6 参考时钟输入的相噪曲线9 7 开环传递函数12