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2018-02-11 发布于江西
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6数字电子基础-时序逻辑电路

环形计数器 D FF0 Q D FF1 Q D FF2 Q D FF3 Q CP 0001 0010 0100 1000 0000 1111 0101 1010 0011 0110 1100 1001 0111 1110 1011 1101 有效循环该电路不能够自启动环形计数器的应用 EN1 EN2 ENn BUS EN1 EN2 EN3 能够自启动的环形计数器 D FF0 Q D FF1 Q D FF2 Q D FF3 Q CP 0001 0010 0100 1000 0000 1001 1010 0101 1101 1100 0110 0011 1011 1110 1111 0111 只利用了 N个状态顺序脉冲发生器顺序脉冲发生器扭环形计数器 D FF0 Q D FF1 Q D FF2 Q D FF3 Q CP 不能够自启动能够自启动 0000 0001 0011 0111 1111 1110 1100 1000 1011 0101 0010 1001 0100 1010 1101 0110 有效循环有效循化具有什么特点？ State Name Q3 Q2 Q1 Q0 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 S1 S2 S3 S4 S5 S6 S7 S8 0 0 0 0 0 0 0 1 0 0 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 0 0 1 0 0 0 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 将扭环形计数器的输出进行译码将扭环形计数器的输出进行译码 0 1 1 X X X X X X X X 1 1 1 1 1 不会存在竞争冒险现象 00 01 11 10 序列信号发生器寄存器 4-位寄存器 4位寄存器CC4076 (并行输入并行输出) * 本章内容寄存器计数器时序逻辑电路分析同步时序逻辑电路的设计南京大学金陵学院—肇莹时序逻辑电路分析特性方程触发器类型特性方程 S-R latch or flip-flop J-K flip-flop D flip-flop T flip-flop T’ flip-flop 时序逻辑电路分析 Mealy 型时序逻辑电路的状态转换图状态时序逻辑电路分析 Moore型时序逻辑电路的状态转换图状态/输出输入时序逻辑电路分析驱动方程: 时序逻辑电路分析当前状态输入次态触发器输入 X J1 K1 J2 K2 0 0 0 0 0 1 0 1 1 0 1 0 1 1 1 1 0 0 0 0 1 1 1 1 0 0 1 0 0 0 0 1 1 1 1 0 0 1 0 1 0 0 1 1 0 0 0 0 1 1 1 1 0 1