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DW_debugger
On-Chip ASCII Debugger
Last Revised: Release DWF_0206
Features and Benefits
● Low gate count
rd_bits wr_bits
● Parameterized data widths
rxd
Description txd
div_bypass_mode
DW_debugger provides a low-gate-count implementation
of an on-chip ASCII debugger. This component clk reset_N
communicates through the use of two pins in serial ASCII,
and allows you to read the rd_bits and write the wr_bits
wires.
Table 1: Pin Description
Pin Name Width Direction Function
clk 1 bit Input Clock
reset_N 1 bit Input Synchronous reset, active low
rd_bits rd_bits_width bit(s) Input Input data bus
rxd 1 bit Input Receive data
wr_bits wr_bits_width bit(s) Output Output data bus
txd 1 bit Output Transmit data
div_bypass_mode 1 bit Input Clock Divider Bypass Control, active high
June 2009 Synopsys, Inc. 1
DesignWare Building Block IP
DW_debugger
On-Chip ASCII Debugger
Table 2: Parameter Description
Parameter Values Description
rd_bits_width 8 to 2048 Width of rd_bits
Default: 8
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