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第2讲 PLD器件
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2.1 CPLD结构与原理
2.2 FPGA结构与原理
2.3 CPLD和FPGA的编程与配置
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2.1 CPLD结构与原理
CPLD - Complex Programmable Logic Device
复杂可编程逻辑器件
CPLD包含三个主要部分:
(1) 逻辑阵列块LAB (Logic Array Block)
(2) 可编程连线阵列PIA
(Programmable Interconnect Array )
(3) I/O控制块IOB (I/O Block)
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例: MAX7000 的总体结构
（Multiple Array Matrix ） 多阵列矩阵
(1)逻辑阵列块LAB ： (2)可编程连线阵PIA
由16个宏单元构成
(3) IOB
控制块
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例: MAX7000 的总体结构
（Multiple Array Matrix ） 多阵列矩阵
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1. LAB (1) LAB 中的三个功能模块
(3)可编程寄存器:
可配置为带可编程时钟的FF
以实现时序逻辑,
来自PIA的36个信号 全局 全局
清零 时钟 也可将其旁路
(2)乘积项选择矩阵:
(1)逻辑阵列: 以实现组合逻辑输出
实现组合逻辑 来自I/O引脚
提供5个乘积项 并 行
快速输入选择
扩展项 2
寄存器
旁 路
通往I/O
模块
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