低功耗并行的提升式53二维离散小波变换的vlsi架构 low power parallel vlsi architecture for lifting-based 53 2-d discrete wavelet transform.pdfVIP

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2017-08-13 发布于上海
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低功耗并行的提升式53二维离散小波变换的vlsi架构 low power parallel vlsi architecture for lifting-based 53 2-d discrete wavelet transform.pdf

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低功耗并行的提升式53二维离散小波变换的vlsi架构 low power parallel vlsi architecture for lifting-based 53 2-d discrete wavelet transform

电子技术研发ElectronicsR＆D 电子技术 10．3969／j．issn．1000—0755．2012．11．007 VLSI架构毛曼卿王春林陈卓刘克刚 (武汉大学电子信息学院) II7．2的平台下对于设计的该系统的时序仿真测试结果表明，综合分析后系统最出了相应的方案。在Quartus 数据吞吐率达到773．944Mbit／s。关键词：离散小波变换；提升式算法；低功耗；并行 LOW PowerParallelVLSI Architecturefor 5／32．D Lifting．based Wavelet Transform Mao ChenZhuLiu ManqingWangChunling Kegang ofElectronic fSch001 Information．Wuhan University) Abstract：DiscreteWavelet needsfor intensive and Transform(DWTl computationprocesslarge toincreaseJEPG2000’S order rOWand architecture．which space．In imagecompressionspeed，an processes 2一D 5／3 transform discretewavelettransformon based iS in scheme this simultaneously,for liffing presentedpaper． Also the schemeaboutthehardware five forthe key of th％PaDergivescorresponding implementation VLSI wavelettransform Columntransform and buffer architecture(1ine module，two