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下一代 I/O 匯流排 PCI-Express 誤碼率測試解決方案 應用手冊 前言及 PCI-Express 的背景介紹 隨著電腦產品變得愈來愈複雜，主機 當資料速率愈來愈高以後，包含獨立 號中，就可以在接收端把時脈回復出來， 板匯流排上的資料速度也愈變愈快。1980 時脈信號線的同步並列匯流排就會面臨時 以消除時序不對稱的問題。這個想法最後 年，ISA （Industry Standard Architecture ） 序不對稱（skew ）的問題。PC 板的設計 證 明 非 常 地 成 功 ： 不 僅 PCI 被 PCI- 匯流排是第一個支援多種 I/O 介面卡的並 人員為了藉由修改跑線的方式來符合設定 Express （PCIe ）所取代 [1] ，而且其它如 列介面，可供繪圖、音效、以及其它人機 與保持時間（setup/hold time ）的規格， IDE/ATA （AT Attachment ）也被改成 S- 介面使用。到了 1992 年，由於市場對更 一直傷透了腦筋，而串訊（crosstalk ）與 ATA ，請參見圖1 。 快速繪圖介面的需求相當殷切，於是乎 接地信號跳動（ground bounce ）還會帶來 EISA （Extended ISA ）演變成為第一版的 另外的 EMI （電磁干擾）問題。為了提高 這些串列介面的必威体育精装版發展已經到第二 PCI （Peripheral Component Intercon- 北橋與南橋的傳輸能力，Intel 公司的工程 代/第三代了，可將資料通道的速度推升 nect ），用以顯示彩色的影像。此時的PCI 師於是提出了將整個架構改為串列式的想 到 5 Gb/s 或 6.5 Gb/s 的範圍。 是一種同步的多落點匯流排（multi-drop 法，因為如果能將時脈信號內嵌在資料信 bus ），最多有32 條資料線，以 33 MHz 的時脈速度運行。 PCI 的發展歷經了幾個革命性的階 段，必威体育精装版版的並列匯流排架構稱為 PCI- X ，是一種64 位元寬、雙倍資料速率達 266 Mb/s 的匯流排架構。在必威体育精装版的標準 中，還有一個 532 Mb/s 的四倍速版本， 但是在撰寫這本應用手冊之際，該規格是 否有實做成果，或是會不會被實做出來仍 不得而知。 圖1：主機板的結構。 PCIe 的基本測試概念 PCIe 的測試環境與設置方式 PCIe 提高了資料傳輸的效率與資料 這份文件的探討重點會放在實體層測 PCIe 測試可分為兩種，第一種是主 的品質，它使用 8b/10b 的編碼方法將時 試的傳送端（TX ）和接收端（RX ）上。 機板的測試，第二種則是附加卡的測試， 脈信號嵌入資料信號中。每一個 PCIe 的 誤碼率測試不僅可以提供系統或晶片組的 請參見圖 2 。 傳輸通道都是一差動傳輸對，最多可以有 功能檢查，在適當的設定下，還可以反映 16 個通道。目前實做出來的資料速率為 出傳送器和接收器的參數能力。我們主要 主機板測試主要是針對主機板上的北 2.5 Gb/s ，在撰寫這份手冊之際，這項標 針對的對象是晶片組的設計人員，特別著 橋或南橋晶片組，這項測試需要使用諸如 準正要升級為速度加倍的第二代，是專為 重在說明如何為 PCIe 晶片組建構出一套 Compliance Load Board （CLB ）的解決方 展頻時脈（Spread Spectrum Clock ，SSC ） 完整的誤碼率測試解決方案。我們將詳細 案來追蹤 TX 和 RX