编码器和解码器.pptVIP

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编码器和解码器

2.5.1 译码器和数字显示;;74LS139的功能表;74LS139管脚图;3位二进制译码器;逻辑表达式;集成二进制译码器74LS138;真值表;74LS138的级联;二、二-十进制显示译码器;按内部连接方式不同,七段数字显示器分为 共阳极 和 共阴极;a;显示译码器:;74LS49的功能表(简表);74LS49与七段显示器件的连接:;2.5.2 编码器;例:用与非门组成三位二进制编码器。; 3位二进制编码器有8个输入端,3个输出端,所以常称为8线—3线编码器,其功能真值表见下表: (输入为高电平有效,即是输入用原变量表示) ; 由真值表写出各输出的逻辑表达式为: ;二、二---十进制编码器;状态表; 在优先编码器中优先级别高的信号排斥级别低的,即具有单方面排斥的特性。;逻辑表达式;逻辑图;集成3位二进制优先编码器;集成3位二进制优先编码器74LS148的真值表;集成3位二进制???先编码器74LS148的级联;用来完成两个二进制数的大小比较的逻辑电路称为数值比较器,简称比较器。;逻辑表达式;二、4位数值比较器;真值表中的输入变量包括A3与B3、A2与B2、A1与B1 、A0与B0和A'与B'的比较结果,A'B'、A'B'和A'=B'。A'与B'是另外两个低位数,设置低位数比较结果输入端,是为了能与其它数值比较器连接,以便组成更多位数的数值比较器;3个输出信号 L1(A>B)、L2(A<B)、和L3(A=B)分别表示本级的比较结果。;逻辑图;三、比较器的级联;串联扩展;并联扩展;1 1 0 1;一、半加器;逻辑图;二、全加器:;半加和:; 全加器SN74LS183的管脚图;例:多位数加法器;并行进位加法器(超前进位加法器);超前进位发生器;加法器的级连;作业

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