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FPGA读写AT24C02实验

FPGA 读写AT24C02 实验 文档编号 作者 jiaqiqiu 版本 1.0 审阅 1 / 10 版本信息记录 版本号 作者 版本信息 更新原因 历史版本 审阅 发布日期 1.0 jiaqiqiu FPGA 读写AT24C02 实验 2 / 10 目录 1. 引言 4 文档目的4 2. 读写AT24C02 基础知识准备 4 2.1 IIC 总线协议简介4 2.2 AT24C02 简介5 3. 代码 6 4. 调试前准备 8 5. 上电调试 9 6. 总结 10 3 / 10 1. 引言 文档目的 介绍 IIC 总线协议,以及FPGA 通过 IIC 接口读写 AT24C02 的实验。本文档未介绍FPGA 读写 AT24C02 的实现细节,关于实现的细节请参考附件中的工程,工程文件夹里有用Ultra Edit 编辑的源文 件,源文件中有详尽的中文注释,可以方便理解如何实现FPGA 读写AT24C02 。 2. 读写AT24C02 基础知识准备 2.1 IIC 总线协议简介 IIC 总线是一种由PHILIPS 公司开发的两线式串行总线,用于连接微控制器及其外围设备。IIC 总线是由数据线SDA 和时钟SCL 构成的串行总线,可发送和接收数据。在CPU 与被控IC 之间、 IC 与IC 之间进行双向传送,最高传送速率 100kbps。 IIC 总线在传送数据过程中共有三种类型信号,它们分别是:开始信号、结束信号和应答信号。 开始信号:SCL 为高电平时,SDA 由高电平向低电平跳变,开始传送数据; 结束信号:SCL 为高电平时,SDA 由低电平向高电平跳变,结束传送数据; 应答信号:接收数据的IC 在接收到8bit 数据后,向发送数据的IC 发出特定的低电平脉冲,表 示已收到数据。CPU 向受控单元发出一个信号后,等待受控单元发出一个应答信号,CPU 接收 到应答信号后,根据实际情况作出是否继续传递信号的判断。若未收到应答信号,由判断为受控 单元出现故障。 下面2 幅图给出了起始、停止、ACK 信号 的时序: 4 / 10 关于IIC 总线协议的详细知识可以参考下面这篇博文: /qiweiwang/archive/2010/11/30/1891868.html 2.2 AT24C02 简介 AT24C02 是一个2K 位串行CMOS E2PROM, 内部含有256 个8 位字节,该器件通过IIC 总 线接口进行操作。通过器件地址输入端A0、A1 和A2 可以实现将最多8 个AT24C02 器件连接到 IIC 总线上。 AT24C02 的存储容量为2Kb ,内容分成32 页,每页8B,共256B,操作时有两种寻址方式: 芯片寻址和片内子地址寻址。 芯片寻址:AT24C02 的芯片地址为1010,其地址控制字格式为1010A2A1A0R/W。其中A2 , A1 ,A0 可编程地址选择位。A2 ,A1 ,A0 引脚接高、低电平后得到确定的三位编码,与 1010 形 成7 位编码,即为该器件的地

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