清华大学课件_时序电路.pdf

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2017-05-01 发布于江苏
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清华大学课件_时序电路

第八章时序逻辑输入输出 Inputs Outputs COMBINATIONAL LOGIC 当前状态组合逻辑下一状态 Current State Next state Registers QD 寄存器 CLK 时钟 2 种存储机理： ? 正反馈 ? 基于电荷 2004－12－1 清华大学微电子所《数字大规模集成电路》周润德第 8 章 (1) 第 1 页存储机理静态动态正反馈 CLK CLK 基于电荷 Q D Q CLK D CLK CLK 2004－12－1 清华大学微电子所《数字大规模集成电路》周润德第 8 章 (1) 第 2 页存储单元的实现方法与比较： o1 i2 i1 V = V V Vo2 1. 利用正反馈（再生）：静态（双稳态）（1）静态：信号可以“无限”保持（2）鲁棒性好：对扰动不敏感 Vo2 = Vi1 （3）对触发脉冲宽度的要求: Vi2 = Vo1 A 触发脉冲的宽度须稍大于沿环路总的传播时间，也即 C（亚稳态点）这两个反相器平均延时的两倍（4）尺寸大 B 限制了在计算结构如流水线式数据通路中的应用