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第3章 组合逻辑电路 3.1.1 组合逻辑电路的分析方法 2. 举例说明组合逻辑电路的分析方法 解：为了方便写表达式，在图中标注中间变量，比如F1、F2和F3。 表3-2 例3-3真值表 ３.2 编码器 3.3.1 二进制译码器 3.3.2 二-十进制译码器 3.3.3 显示译码器 以四选一数据选择器为例。 (2)四选一数据选择器的功能表 3.4.2 八选一数据选择器74LS151 3.4.3 应用举例  3.5 　加法器 3.5.2　多位加法器 （3）分析整个电路的逻辑功能 图3-29电路可以实现一位十进制数的加 法运算，并由数码管显示相加的结果。当相 加的结果大于9（即二进制1001）时，数码 管不显示，处于灭灯状态。 解：（1）划分功能块 　　 电路可分成三个功能块： 　　 ① 加法运算及比较电路， 　　 ② 译码电路， 　　 ③ 显示电路。 （2）分析各功能块的逻辑功能 ① 4位加法器74LS283 S3S2S1S0是A3A2A1A0与B3B2B1B0的和，当＜1010时，比较电路输出YA＜B=1。 伟躇惫拾沫佃偏君院垃吩佯椰堑处凸罪盯渔王郊破窍潮时手酪捍挤谗颂蔡数字电路 组合逻辑电路数字电路 组合逻辑电路 具体电路见图3-21： 图3-21 例3-5电路图 D0 = D3 =D5 =D7 =1 D1 = D2 =D4 =D6 =0 S＝0 倒售酣爵谜泰划珠店揩雨骸施鞋甚滥再惨预撤邵娱梭眼诫滥质郝综直悍贺数字电路 组合逻辑电路数字电路 组合逻辑电路 A B C F 0 0 0 1 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 0 1 0 1 1 1 1 0 0 1 1 1 1 真值表对照法 注意变量 高低位顺序！ 盗夺成勋谁鹿酉疥钩橡氓牢解藕缠着窘衫摊碰战祟筑孪讲咋缕穿蔗狡幼辫数字电路 组合逻辑电路数字电路 组合逻辑电路 例3-6　试用八选一电路实现三变量多数表决电路。 表3-11 例3-6的真值表 A B C F 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 0 1 0 1 1 1 1 0 1 1 1 1 1 解：假设三变量为A、B、C，表决结果为F，则真值表如表3-11所示。 郸迂隐波鼠圆截穆梗蒸左蛀赣坤协懊葫述大衫瘩孔明屠服厄僧蔚带烤牵河数字电路 组合逻辑电路数字电路 组合逻辑电路 　　 在八选一电路中，将A、B、C从A2、A1、A0 输入，令 D3 = D5 =D6 =D7 =1 D0 = D1 =D2 =D4 =0 S＝0 F＝Y 　　则可实现三变量多数表决电路，具体电路图请读者自行画出。 则 矣郧载郝抠萎拍禄熄翌之同端斜每惟邱铁袄雷挽盲扣隋漏男端棋须固熄咬数字电路 组合逻辑电路数字电路 组合逻辑电路 　　思考： 　　若用8选1实现4变量的函数， 　　或者用4选1实现3变量的函数， 　　即地址输入端的个数比变量个数小1， 　　如何实现？如： A B C F 0 0 0 1 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 0 1 0 1 1 1 1 0 0 1 1 1 1 输 入 输 出 S A1 A0 Y 0 × × 0 1 0 0 D0 1 0 1 D1 1 1 0 D2 1 1 1 D3 燕漆恃惶屎潮梳驮唯唐细原箕荡锄线涨枫猖铲效氧酒箔测虽咎贺稳窟卡句数字电路 组合逻辑电路数字电路 组合逻辑电路 　　算术运算是数字系统的基本功能，更是计算机中不可缺少的组成单元。本节介绍实现加法运算的逻辑电路。 3.5.1 全加器　　 　　本章的3.1节讨论过半加器电路，它是不考虑低位进位的加法器。 　　全加器能把本位两个加数An 、 Bn 和来自低位的进位Cn-1三者相加，得到求和结果Sn 和该位的进位信号Cn 。 们垢茫麻拌清愧昔铡镀酣惶蒂洲瞧棋态利俄桑各藤佑峰市兔整虑撮歹差焚数字电路 组合逻辑电路数字电路 组合逻辑电路 表3-12 全加器 的真值表 Sn Cn 0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 1 0 1 0 1 1 1 0 0 1