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2017-01-02 发布于广东
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组合逻辑电路门电路与组合逻辑电路门电路与组合逻辑电路 5.7 加法器 5.7.1 半加器两个 1 位二进制数相加不考虑低位进位。 0 0 0 1 1 0 1 1 0 0 1 0 1 0 0 1 真值表函数式 A+B = S (和) ? CO (进位) 逻辑图逻辑符号半加器 S A B =1 CO 5.7.2 全加器两个 1 位二进制数相加，考虑低位进位。 A + B + Ci ( 低位进位 ) = S ( 和 ) ? CO ( 向高位进位 ) 1 0 1 1 --- A 1 1 1 0 --- B + --- 低位进位 1 0 0 1 0 1 1 1 1 真值表 A B Ci 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 S CO A B Ci S C 0 0 1 0 1 0 0 1 1 0 0 1 0 1 1 1 --- S 高位进位← 0 表达式逻辑图用与门、或门和异或门实现逻辑符号【例5－17】试用2个一位半加器和基本逻辑门电路（与、或、非）实现一位全加器。解：按以上公式可用2个一位半加器和一个或门来实现，如图所示。组合逻辑电路门电路与组合逻辑电路门电路与组合逻辑电路