【数字电路设计课件】组合逻辑电路.pptVIP

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2017-09-26 发布于重庆
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【数字电路设计课件】组合逻辑电路.ppt

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* * 组合逻辑电路退出总目录 ※ 常用MSI组合逻辑器件编码器数据选择器数码比较器加法器译码器 ※ 译码器的应用 ※ MSI组合逻辑器件的扩展方法数据分配器 ※ 组合电路的分析方法与设计方法总目录退出目录组合电路的分析方法与设计方法总目录退出目录逻辑抽象的主要工作分析事件的因果关系，确定输入变量和输出变量定义逻辑状态的含义根据给定的因果关系列出真值表将逻辑函数变换为适当的形式使用SSI门电路进行设计时，应将函数式化简为最简形式，并变换成与器件种类相适应的形式使用常用MSI组件进行设计时，应将函数式变换成所用器件函数式相同或类似的形式，并用最少的器件和最简单的连线构成电路常用MSI组合逻辑器件总目录退出目录常用MSI组合逻辑器件目录总目录退出常用MSI组合逻辑器件目录总目录退出译码器的应用目录总目录退出实现存储系统的地址译码可用作数据分配器或脉冲分配器可以实现多输出组合逻辑函数 [例1] 用少量门电路控制译码器的使能端可以实现多地址译码。因3-8译码器使能端E1E2AE2B=100时才能工作，图1(a)电路中，当A7A5A3=111，A6A4=00， A2A1A0从000～111变化时 Y0～Y7分别被译中，所以该电路可以对8根地址输入线 (A7～A0)分别在A8H～AFH状态时进行译码。同理，图1(b)电路中，当 A9A7A6A5=1111、 A8=A4=A3=0时，电路可以对8根地址输入线(A7 ～A0)分别在2E0H～2E7H状态时进行译码。目录总目录退出译码器图1(a) 图1(b) 目录总目录退出译码器 [例2] 用3-8译码器构成8路脉冲分配器目录总目录退出译码器解：① CP加在E1端在CP=1时译码电路图：波形图：波形图：目录总目录退出译码器电路图： ② CP加在E2端在CP=0时译码 [例3] 已知：F1=D(B+C)(B+C)(A+B) F2=(A+B+D)(A+C+D) 用3-8译码器加少量门电路实现4变量逻辑函数。图3(a) F1 F2 目录总目录退出译码器解：⑴ 根据函数式画出F1 F2的卡诺图，如图3(a)所示： ⑵ 从图中看出：当D变量为1时： F1=0、F2=1 D变量为0时： F1=(B+C)(B+C)(A+B)=∑m(A B C)(0 3 4) F2=(A+B)(A+C)=∏M(A B C)(4 6 7) 因此可以用D变量控制3-8译码器的使能端E2A(或E1或E2B) 将A、B、C加至地址输入端，加少量门，实现4变量函数。电路如图3(b)所示：图3(b) 目录总目录退出译码器㈠利用使能端进行扩展㈡树状扩展目录总目录退出 *