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实验一四位加法器和减法器设计
一、问题描述：
1、设计一个4bit加法器，采用两种不同的结构实现（串行结构和超前进位
链结构）。并进行功能仿真，并分析比较两种不同的四位加法器的异同。
2、在4bit加法器的基础上设计一个4bit的减法器，并进行功能仿真。
二、输入和输出信号描述
1、加法器
input:A3A2A1A0：加数输入。
B3B2B1B0：加数输入。
C0：进位输入
output:S3S2S1S0：和数输出
C4：进位输出
2、减法器
input:A3A2A1A0：减数输入
B3B2B1B0：被减数输入
C0：借位输入
output:S3S2S1S0：结果输出
C4：借位输出
三、结构框图
（1）串行加法器的结构图
A0B0
A1B1A2B2A3B3
+++
C0C1C2C3C4
S0S3
S1S2
其中1位全加器的结构如下：
Experiment1Four-bitadderandsubtracterdesign
1.Problemdescription:
1.Designa4bitadder,usingtwodifferentstructures(serialstructureandhyper-carrychain
structure).Andperformfunctionalsimulation,andanalyzeandcomparethesimilaritiesand
differencesweentwodifferentfour-bitadders.2.Designa4bitsubtractorbasedonthe4bit
adderandperformfunctionalsimulation.
2.Inputandoutputsignaldescription
1.Adder
input:A3A2A1A0:Additioninput.B3B2B1B0:
Additioninput.C0:Carryinputoutput:
S3S2S1S0:SumoutputC4:Carryoutput
2.Subtractor
input:A3A2A1A0:Subtractedinput
B3B2B1B0:SubtractedinputC0:Borrow
inputoutput:S3S2S1S0:ResultoutputC4:
Borrowoutput
3.Structural
blockdiagr
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