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基于VHDL的简易数字频率的仿真计.doc

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    题目基于VHDL的简易数字频率的仿真计

    摘要

    本研究论文主要采用自上向下的一种电子系统设计的量程描述方法，设计的是一种基于VHDL的硬件量程描述语言的一种能够可以将量程变换为多个量程的数字频率计。该系列数字频率器的频率的计数器测量范围在1hz~100mhz之间，在这次的计数器测量完成后才表示可以继续显示下一次测量的数据，并且继续保持一直到最后的下一次计数器测量信号结束，并在测量信号超出上一次量程的范围时候可以显示测量错误并且发出报警。该系列数字频率器主要是由八个测频控制模块组成，分别为：分频器，计

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