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本发明公开一种基于交叉链接插入的芯片中时钟网络构建方法，包括步骤：输入芯片电路，初始时钟树构建；进行两阶段聚类，包括基于几何位置的聚类和基于时序的聚类，基于几何位置的聚类为将顺序相邻的触发器分配给同一个聚类，基于时序的聚类为根据触发器之间的偏斜约束来进行聚类；根据聚类结果，选择关键触发器对；根据所选择的关键触发器对，构建交叉链接结构；基于交叉链接结构，输出最终的时钟网络。本发明能够有效减少功耗，能够应对在工艺波动下易受影响的触发器对，避免线长增加。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117852491A
(43)申请公布日2024.04.09
(21)申请号202410008441.X
(22)申请日2024.01.04
(71)申请人西南科技大学
地址621000
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