一种除法器逻辑电路及实现除法器逻辑电路的方法.pdfVIP

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2024-01-03 发布于四川
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一种除法器逻辑电路及实现除法器逻辑电路的方法.pdf

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本发明属于逻辑电路技术领域，尤其涉及一种除法器逻辑电路及实现除法器逻辑电路的方法，用于求得一被除数X与一除数5n的商和余数，包括：加法器、寄存器和移位控制器；移位控制器用于根据输入除数的幂次方n，采用查找表方式分别读取商和余数对应的控制字，根据控制字控制加法器和寄存器完成求商循环和求余数循环，得到求商和余数的结果。本发明的除法器的实现方法运算速度快，所用时钟周期少，设计易于实现。

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN117331529A

(43)申请公布日2024.01.02

(21)申请号202311628819.8

(22)申请日2023.12.01

(71)申请人泰山学院

地址271000