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本方案涉及一种线性忆阻器的等效电路,包括第一端口、第二端口、信号输入模块、信号处理模块和信号输出模块,第一端口和第二端口连接信号输入模块的输入端,信号输入模块的输出端连接信号处理模块的输入端,信号处理模块的输出端连接信号输出模块的输入端,信号输出模块的第一输出端连接第一端口、信号输出模块的第二输出端连接第二端口,信号输入模块用于调节输入信号,信号处理模块用于存储并输出用于控制信号输出模块开启和关闭的电平,信号输出模块用于确认输出通路。本发明可以实现双端口输入,实现忆阻器非易失性存储的特性和高阻值
(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 116978429 A (43)申请公布日 2023.10.31 (21)申请号 202310827828.3 (22)申请日 2023.07.06 (71)申请人 广东工业大学 地址 510006
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