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2023-11-01 发布于四川
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本发明提供一种能够降低时钟信号的频率中的过冲产生的频率同步电路。频率同步电路包括：数字电路，接收基准时钟信号、倍频数信号以及用于频率同步环的反馈信号而提供规定振荡频率的输出信号；以及数字控制振荡电路，构成为生成具有与输出信号相应的频率的时钟信号并且将时钟信号提供给反馈输入以及输出，数字电路进行闭环动作或开环动作，数字电路构成为，在闭环动作中将基于反馈信号、倍频数信号以及基准时钟信号而确定的环值提供给输出信号，在开环动作中将与环值不同的值提供给输出信号，开环动作中的值能够使数字控制振荡电路以与和基

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 116979961 A (43)申请公布日 2023.10.31 (21)申请号 202310445615.4 (22)申请日 2023.04.24 (30)优先权数据