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本发明提供了一种基于多通路独立AXI总线的RLDRAM3控制器，控制模块通过AXI‑LITE接口连接FPGA片上微处理器，对RLDRAM3控制器进行控制；用户访问模块提供用户访问接口，提供用户数据读写；大数据交互模块基于用户访问模块初始优先级及二级缓存中积压数据量进行实时优先级调整，从用户访问模块中取出读写指令队列内容，并根据地址内容发送至物理层模块进行数据交互；物理层模块完成复位链路初始化控制、对RLDRAM3芯片DDR模式读写总线时序编解码、地址控制总线的时序控制。本发明支持多个AXI主设备
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113360424 A
(43)申请公布日 2021.09.07
(21)申请号 202110667155.0
(22)申请日 2021.06.16
(71)申请人 上海创景信息科技有限公司
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