时钟校准电路和可编程逻辑芯片.pdfVIP

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2023-06-20 发布于四川
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本申请提供了一种时钟校准电路和可编程逻辑芯片，涉及集成电路技术领域，改善多个电路单元间信号延时的问题。该电路包括：第一延时电路包括第一延时单元和第一控制电路，第一延时单元在第一控制电路的控制下向鉴相器输入第一输出时钟。第二延时电路包括第二延时单元和第二控制电路，第二延时单元在第二控制电路的控制下向鉴相器输入第二输出时钟。鉴相器计算第一输出时钟和第二输出时钟的相位之差得到比较结果，比较结果大于或等于相位阈值时，将比较结果反馈至第一延时电路和/或第二延时电路，第一控制电路根据比较结果向鉴相器输入新的

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113315493 A (43)申请公布日 2021.08.27 (21)申请号 202110413808.2 (22)申请日 2021.04.16 (71)申请人深圳市紫光同创电子有限公司