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本发明公开了一种存储器数据读取系统，数字控制模块将外部时钟进行N倍分频得到一级读时钟；模拟控制模块包括电阻电容延时电路、与逻辑电路；电阻电容延时电路用于将一级读时钟进行迟延得到迟延读信号；与逻辑电路将一级读时钟同迟延读信号相与，得到二级读时钟；读时序控制模块以二级读时钟作为工作时钟，控制灵敏放大器输出所选地址对应存储单元中的数据。本发明的存储器数据读取系统，无论在外部时钟快还是慢，均能及时结束储器存储单元每个读操作周期中的预充电，避免了存储器芯片读数据预充电时间过长耗电大且对存储单元有干扰的问题
(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112466357 A (43)申请公布日 2021.03.09 (21)申请号 202011416867.7 (22)申请日 2020.12.07 (71)申请人 普冉半导体（上海）股份有限公司
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