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本发明公开一种相位校准电路结构,属于集成电路领域,包括压控延时链、第一调制回路、第二调制回路和鉴相器;其中,所述鉴相器输出信号经一级缓冲器送到所述第二调制回路,再经另一级缓冲器送到所述第一调制回路;所述第一调制回路通过数字模块检测电路状态值调节所述压控延时链,将两时钟相位差值调制到设定的两个相位差值之间;所述第二调制回路通过反馈电路输出控制电压调节所述压控延时链,将两时钟相位差值调制到设定的两个相位差值中间。引入第二调制回路是为了避免校准后的相位落在设定的相位边缘,提高了电路相位校准的准确性和可
(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114726349 A (43)申请公布日 2022.07.08 (21)申请号 202210373261.2 (22)申请日 2022.04.11 (71)申请人 中国电子科技集团公司第五十八研
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