数字集成电路设计中状态机的验证方法及验证系统.pdfVIP

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2023-05-06 发布于北京
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数字集成电路设计中状态机的验证方法及验证系统.pdf

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本发明提供了一种数字集成电路设计中状态机的验证方法及其验证系统，该验证方法通过将状态机在各个状态时预期出现的输出信号和交互信号列在表格中，之后根据表格内各信号的预期变化，编写相应的第一SVA断言。在使用仿真模块仿真运行状态机时，每个第一SVA断言自动检查状态机在各个状态的对应信号的时序，自动判断为断言成功还是断言失败，快捷的对状态机的输出信号和交互信号进行验证，提高验证效率。相比传统scoreboard比对的验证方式，本发明的方案应用在block级甚至UT级的数字集成电路验证时，基于SVA断言，

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114330179 A (43)申请公布日 2022.04.12 (21)申请号 202111636387.6 (22)申请日 2021.12.29 (71)申请人展讯通信（上海）有限公司