多通道高速AD采样装置.pdfVIP

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2023-03-01 发布于四川
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多通道高速AD采样装置.pdf

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本发明公开的一种多通道高速AD采样装置，通用性好，采样速率高。本发明通过下述技术方案实现：FPGA电路配置锁相环PLL和高速AD芯片，将外部连接器输入或由板载晶振，通过锁相环PLL锁相后输出AD采样时钟提供给高速AD芯片作为采样时钟；模拟中频信号通过至少4个任一路SMP插座送入ADC通道上，经过模拟匹配电路后送入模数AD采集电路进行采样，根据时钟同步电路输入同步SYNC信号，将采样信号送入各自ADC通道上串联的变压器采样，转成4组支持片间同步的低电压差分信号LVDS，采样后的高速LVDS并行数据

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113572474 A (43)申请公布日 2021.10.29 (21)申请号 202110877438.8 (22)申请日 2021.07.31 (71)申请人西南电子技术研究所(中国电子科